Logiciel en langage C permettant de simuler un décodeur LDPC "au bit près" pour le standard DVB-S2.
La conception d'architecture électronique doit être étroitement alignée avec les algorithmes LDPC, nécessitant une optimisation coordonnée prenant en compte le parallélisme, la quantification et la gestion mémoire.
L'innovation offre un logiciel en C permettant de tester divers paramètres en harmonie avec l'architecture : taux de codage, Itérations, quantification des bits, parallélisme, algorithme de décodage, etc. Ce modèle facilite l'implémentation d'un décodeur LDPC pour le standard DVB-S2, répondant aux besoins croissants de débit élevé dans la transmission de contenu multimédia par satellite.
TRL4 - Démonstration en laboratoire
UMR 6285 - LABSTICC
Laboratoire des sciences et techniques de l'information, de la communication et de la connaissance
FR : IDDN.FR.001.310025.000.S.P.2014.000.10600 - déposé le 25/07/2014
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